[发明专利]用于子系统的具有可配置的侧边输入/输出端的硬宏无效
| 申请号： | 200580041321.5 | 申请日： | 2005-09-21 |
| 公开（公告）号： | CN101069185A | 公开（公告）日： | 2007-11-07 |
| 发明（设计）人： | 卡若琳·卡里恩;埃曼努埃尔·艾里 | 申请（专利权）人： | 皇家飞利浦电子股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 朱进桂 |
| 地址： | 荷兰艾*** | 国省代码： | 荷兰;NL |
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| 摘要： | 一种用于诸如数据处理器的子系统(TMi)的硬宏器件(HMD)，包括处理核心(C)，所述处理核心(C)有：适于馈送要处理的时间关键输入数据的至少一个时间关键输入端(CIT)；适于传递已处理的时间关键输出数据的至少一个时间关键输出端(COT)。处理核心(C)至少部分地由连接接口区域(CIZ)包围，所述CIZ包括i)位于已选位置并适于接收要处理的时间关键输入数据的至少两个时间关键辅助输入端(AITj)的至少一输入组，和/或位于所选位置并适于传递已处理的时间关键输出数据的至少两个时间关键辅助输出端(AOTk)的至少一输出组，ii)输入连接装置(LO)，用于将所述输入组的每个时间关键辅助输入端(AITj)连接到时间关键输入端(CIT)，和/或iii)输出连接装置(Bk)，用于将时间关键输出端(COT)连接到所述输出组的每个时间关键辅助输出端。 | ||
| 搜索关键词： | 用于 子系统 具有 配置 侧边 输入 输出 | ||
【主权项】：
1、一种用于子系统(TMi)的硬宏器件(HMD)，所述硬宏器件(HMD)包括处理核心(C)，所述处理核心C具有：适于馈送要处理的时间关键输入数据的至少一个时间关键输入端(CIT)、以及适于传递已处理的时间关键输出数据的至少一个时间关键输出端(COT)，其特征在于，所述处理核心至少部分由连接接口区域(CIZ)包围，所述连接接口区域包括：i)位于选定位置且适于接收要处理的时间关键数据输入数据的至少两个时间关键辅助输入端(AITj)的至少一个输入组，和/或位于选定位置且适于传递已处理的时间关键输出数据的至少两个时间关键辅助输出端(AOTk)的至少一个输出组；ii)用于将所述输入组的每个时间关键辅助输入端(AITj)连接到所述时间关键输入端(CIT)的输入连接装置(LO)；和/或iii)用于将所述时间关键输出端(COT)连接到所述输出组的每个时间关键辅助输出端(AOTk)的输出连接装置(Bk)。
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