[发明专利]时钟提取电路无效
| 申请号： | 200610006206.0 | 申请日： | 2006-01-23 |
| 公开（公告）号： | CN1815945A | 公开（公告）日： | 2006-08-09 |
| 发明（设计）人： | 铃木裕久;长谷川和男;赤间英治 | 申请（专利权）人： | 三洋电机株式会社 |
| 主分类号： | H04L7/033 | 分类号： | H04L7/033 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 李香兰 |
| 地址： | 日本国*** | 国省代码： | 日本;JP |
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| 摘要： | 提供一种时钟提取电路，接收根据时钟信号对传送对象的数字信号进行了编码的编码信号，从该编码信号提取时钟信号，包括：边沿检测单元，其检测所接收的编码信号的上升沿和下降沿，生成表示已检测出的意思的边沿检测脉冲；屏蔽信号生成单元，其根据在接收的编码信号的每一周期生成的边沿检测脉冲，将生成每一周期的边沿检测脉冲作为契机，生成相位反相的屏蔽信号；屏蔽信号延迟单元，其生成以可以控制的延迟时间量延迟屏蔽信号的屏蔽延迟信号；时钟生成单元，其根据屏蔽延迟信号的边沿生成时钟信号；和延迟控制单元，其将生成的时钟信号的占空比设定成预定值，控制屏蔽信号延迟单元的延迟时间。这样可以从由外部接收的编码信号中正确提取时钟信号。 | ||
| 搜索关键词： | 时钟 提取 电路 | ||
【主权项】：
1、一种时钟提取电路，接收根据时钟信号对传送对象的数字信号进行了编码的编码信号，从该编码信号提取所述时钟信号，包括：边沿检测单元，其检测所接收的所述编码信号的上升沿和下降沿，生成表示已检测出的意思的边沿检测脉冲；屏蔽信号生成单元，其根据在所述接收的编码信号的每一周期生成的所述边沿检测脉冲，将生成所述每一周期的所述边沿检测脉冲作为契机，生成相位反相的屏蔽信号；屏蔽信号延迟单元，其生成以可以控制的延迟时间量延迟所述屏蔽信号的屏蔽延迟信号；时钟生成单元，其根据所述屏蔽延迟信号的边沿生成所述时钟信号；和延迟控制单元，其将所述生成的时钟信号的占空比设定成预定值，控制所述屏蔽信号延迟单元的延迟时间。
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