[发明专利]具有场氧化物膜的半导体器件的制造方法无效
申请号: | 200610006799.0 | 申请日: | 2006-01-28 |
公开(公告)号: | CN1819137A | 公开(公告)日: | 2006-08-16 |
发明(设计)人: | 高见秀诚;深见博昭 | 申请(专利权)人: | 雅马哈株式会社 |
主分类号: | H01L21/76 | 分类号: | H01L21/76 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 陶凤波;侯宇 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供了一种具有场氧化物膜的半导体器件的制造方法。在硅衬底的主表面上,由氮化硅制成的侧分隔件形成在包括氧化硅膜、氮化硅膜和氧化硅膜的叠层的侧壁上。此后,通过使用该叠层、侧分隔件和抗蚀剂层作为掩模注入杂质离子而形成沟道停止离子掺杂区。在除去抗蚀剂层和侧分隔件后,通过采用叠层作为掩模的选择氧化形成场氧化物膜,并形成相应于离子掺杂区的沟道停止区。在除去该叠层后,例如MOS型晶体管的电路器件形成在场氧化物膜的每个器件开口中。 | ||
搜索关键词: | 具有 氧化物 半导体器件 制造 方法 | ||
【主权项】:
1、一种半导体器件制造方法,包括如下步骤:制备硅衬底,其具有至少一个一种导电类型的区;在所述硅衬底的主表面上从底部按照所提及的顺序层叠第一氧化硅膜、氮化硅膜和第二氧化硅膜;根据期望的器件开口图案,构图至少包括所述第一氧化硅膜、所述氮化硅膜和所述第二氧化硅膜中的所述氮化硅膜和所述第二氧化硅膜的叠层;形成由氮化硅制成并覆盖所述叠层一侧的侧分隔件;通过采用所述叠层和所述侧分隔件作为掩模,注入所述第一种导电类型的杂质离子到所述硅衬底的主表面中,以形成沟道停止离子掺杂区;和在除去所述侧分隔件后,通过采用所述叠层作为掩模的选择氧化,形成具有相应于所述硅衬底主表面上的所述叠层的器件开口的场氧化物膜,并在所述离子掺杂区的基础上形成所述一种导电类型的沟道停止区。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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