[发明专利]DDR和DDR2内存控制器的读数据采样方法及装置有效
| 申请号： | 200610008091.9 | 申请日： | 2006-02-28 |
| 公开（公告）号： | CN101030441A | 公开（公告）日： | 2007-09-05 |
| 发明（设计）人： | 张斌;胡明昌;李文;蔡飞;曾洪博 | 申请（专利权）人： | 中国科学院计算技术研究所 |
| 主分类号： | G11C7/22 | 分类号： | G11C7/22;G11C7/10 |
| 代理公司： | 北京泛华伟业知识产权代理有限公司 | 代理人： | 高存秀 |
| 地址： | 100080北京*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种DDR和DDR2内存控制器的延时滤波电路，由与门、或门和延时单元组成，延时滤波电路分为数据选通信号上升沿处理部分和数据选通信号下降沿处理部分。上升沿处理部分包括延时单元和与门，数据选通信号上升沿处理部分按级分类，每一级有一延时单元和一个与门；延时单元的输入端输入数据选通信号，输出端和本级的与门的一个输入端连接；与门的另一个输入端直接与未延时的数据选通信号连接，与门的输出端与下一级的延时单元的输入端相连，在最后一个级中，与门的输出端与外部电路连接。下降沿处理部分将上升沿处理部分的与门转换为或门。本发明在完成DQS延时的同时，可以滤除DQS的毛刺，并且可以软件配置DQS延时的长度。 | ||
| 搜索关键词： | ddr ddr2 内存 控制器 读数 采样 方法 装置 | ||
【主权项】：
1、一种DDR和DDR2内存控制器的读数据采样装置，包括：DDR内存控制器的延时滤波电路和D触发器，其特征在于：所述的DDR内存控制器的延时滤波电路用于对数据选通信号的延时滤波，由与门、或门和延时单元组成，所述的延时滤波电路分为数据选通信号上升沿处理部分和数据选通信号下降沿处理部分，其中：所述的数据选通信号上升沿处理部分包括延时单元和与门，所述的数据选通信号上升沿处理部分按级分类，每一级有一延时单元和一个与门；所述的延时单元的输入端输入数据选通信号，其输出端和延时单元所在级的与门的一个输入端连接；所述的与门有两个输入端，一个输入端与本级的延时单元的输出端连接，另一个输入端直接与未延时的数据选通信号连接，所述的与门有一个输出端，该输出端与下一级的延时单元的输入端相连，在最后一个级中，所述的与门的输出端与外部电路连接；所述的数据选通信号下降沿处理部分包括延时单元和或门，所述的数据选通信号下降沿处理部分按级分类，每一级有一延时单元和一个或门；所述延时单元的输入端输入数据选通信号，其输出端和延时单元所在级的或门的一个输入端连接；所述的或门有两个输入端，一个输入端与本级的延时单元的输出端连接，另一个输入端直接与未延时的数据选通信号连接，所述或门有一个输出端，该输出端与下一级的延时单元的输入端相连，在最后一个级中，所述或门的输出端与外部电路连接。
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