[发明专利]同相移位方式的制约竞争计数码电路无效
| 申请号： | 200610041210.0 | 申请日： | 2006-07-28 |
| 公开（公告）号： | CN1921316A | 公开（公告）日： | 2007-02-28 |
| 发明（设计）人： | 李冰 | 申请（专利权）人： | 东南大学 |
| 主分类号： | H03M7/16 | 分类号： | H03M7/16;H03M7/14 |
| 代理公司： | 南京经纬专利商标代理有限公司 | 代理人： | 陆志斌 |
| 地址： | 21402*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开一种同相移位方式的制约竞争计数码电路，包含16位移位寄存器(A)、16位移位寄存器(B)、4位码输出寄存器(C)、初始化预置开关(D)、初始化预置开关(E)，移位寄存器(A、B)的最高位和最低位首尾相接，移位寄存器(A、B)分别被初始化预置开关(D、E)预置为固定的特征序列，计数脉冲接16位寄存器的移位控制端口(CLK)，移位寄存器(B、A)的第0位分别接4位码输出锁存器的低两位，移位寄存器(B、A)的第12位，分别接4位码输出锁存器的高两位。经过初始化预置后，输入脉冲，通过同相移位可以实现计数，并输出制约竞争计数码。 | ||
| 搜索关键词： | 相移 方式 制约 竞争 数码 电路 | ||
【主权项】：
1、一种同相移位方式的制约竞争计数码电路，包含16位移位寄存器(A)、16位移位寄存器(B)、4位码输出寄存器(C)、初始化预置开关(D)、初始化预置开关(E)，其特征在于，移位寄存器(A)的最高位和最低位首尾相接，移位寄存器(B)的最高位和最低位首尾相接，脉冲输入信号分别接移位寄存器(A)和移位寄存器(B)的移位控制端口(CLK)，移位寄存器(A)被初始化预置开关(D)预置为固定的特征序列0111111110000000，移位寄存器(B)被初始化预置开关(E)预置为固定的特征序列0001110011100011，移位寄存器(B)并行输出的由低到高的第12位和码输出寄存器(C)的数据最高输入位(d3)连接，移位寄存器A并行输出的由低位到高位的第12位和码输出寄存器C的数据次高位(d2)连接，移位寄存器(B)并行输出的由低位到高位的第0位和码输出寄存器(C)的数据次低位(d1)连接，移位寄存器(A)并行输出的由低位到高位的第0位和码输出寄存器(C)的数据最低位(d0)连接，由码输出寄存器(C)的输出控制端控制输出由高位(d3)到低位(d0)的4位制约竞争计数码。
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