[发明专利]半导体存储装置的管道锁存装置有效
| 申请号： | 200610121570.1 | 申请日： | 2006-08-22 |
| 公开（公告）号： | CN1941191A | 公开（公告）日： | 2007-04-04 |
| 发明（设计）人： | 金京男;赵浩烨 | 申请（专利权）人： | 海力士半导体有限公司 |
| 主分类号： | G11C11/4093 | 分类号： | G11C11/4093;G11C11/4063 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 郭定辉;黄小临 |
| 地址： | 韩国*** | 国省代码： | 韩国;KR |
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| 摘要： | 本发明提供管道锁存装置，其包括：输出控制器，其基于一DLL时钟信号及驱动信号输出第一及第二输出控制信号群；输入控制器，其用于产生一输入控制信号群；及管道锁存单元，其用于当激活一对应输入控制信号时将数据锁存在数据线上，且当激活一对应输出控制信号时输出经锁存的数据，其中该输出控制器包括：多个移位器，每一移位器用于使输入数据信号延迟半个时钟及一个时钟，以与该DLL时钟信号及该驱动信号同步地输出第一及第二输出信号；及多个输出控制信号驱动器，其基于所述第一及第二输出信号输出所述第一及第二输出控制信号群。 | ||
| 搜索关键词： | 半导体 存储 装置 管道 | ||
【主权项】：
1.一种管道锁存装置，其包含：输出控制器，其基于延迟锁定回路(DLL)时钟信号及驱动信号输出第一及第二输出控制信号群；输入控制器，其产生基于行相关时钟信号顺序地激活的输入控制信号群；及管道锁存单元，其包括多个单元管道锁存器，每一单元管道锁存器用于当激活该输入控制信号群中的对应输入控制信号时将数据锁存在数据线上，且当激活所述第一及第二输出控制信号群中的对应输出控制信号时输出经锁存的数据，其中该输出控制器包括：多个移位器，每一移位器将输入数据信号分别延迟半个时钟及一个时钟，以分别与该DLL时钟信号及该驱动信号同步地输出第一及第二输出信号；及多个输出控制信号驱动器，其基于所述多个移位器的所述第一及第二输出信号输出所述第一及第二输出控制信号群。
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