[发明专利]乘法器无效
| 申请号： | 200610130999.7 | 申请日： | 2006-12-30 |
| 公开（公告）号： | CN101042639A | 公开（公告）日： | 2007-09-26 |
| 发明（设计）人： | W·K·费格哈利;W·C·哈森普洛夫;G·M·沃尔里希;D·F·卡特;V·戈帕尔;G·高巴茨 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F7/72 | 分类号： | G06F7/72;H04L9/06 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 程天正;刘杰 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 一般的，在一方面，本发明描述了一个乘法器，包括被并联配置的一组多个乘法器，该组多个乘法器访问一个第一操作数和一个第二操作数以相乘，该第一操作数具有多个分段并且该第二操作数具有多个分段。该乘法器还包括重复提供第二操作数的一个单个分段到该组多个乘法器的每个乘法器并且提供第一操作数的多个相应分段到该组多个乘法器的相应乘法器的逻辑，直到第二操作数的每个分段被提供以第一操作数的每个分段。所述逻辑至少部分地基于相应分段在第一操作数里的位置对该组多个乘法器的不同输出进行移位。乘法器还包括与所述逻辑器相耦合的累加器。 | ||
| 搜索关键词： | 乘法器 | ||
【主权项】：
1.一种用于将第一操作数和第二操作数相乘的乘法器，包括：被并联配置的一组多个乘法器，该组多个乘法器访问一个第一操作数和一个第二操作数以相乘，该第一操作数具有多个分段并且该第二操作数具有多个分段；用于重复提供第二操作数的一个单个分段到该组多个乘法器的每个乘法器并且同时提供第一操作数的多个相应分段到该组多个乘法器的相应乘法器的电路，直到第二操作数的每个分段被提供以第一操作数的每个分段，该电路至少部分地基于所述相应分段在第一操作数内的位置对该组多个乘法器的不同乘法器输出进行移位；以及一个与所述电路相耦合的累加器。
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