[发明专利]脉冲静态触发器有效
| 申请号： | 200610156777.2 | 申请日： | 2006-12-27 |
| 公开（公告）号： | CN1992519A | 公开（公告）日： | 2007-07-04 |
| 发明（设计）人： | 西格马尔·克佩;克里斯汀·帕齐;卡尔·载普 | 申请（专利权）人： | 印芬龙科技股份有限公司 |
| 主分类号： | H03K3/353 | 分类号： | H03K3/353 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 朱进桂 |
| 地址： | 德国*** | 国省代码： | 德国;DE |
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| 摘要： | 一种脉冲静态触发器(1)，用于存储逻辑信号(/D1)的逻辑状态，所述触发器具有：第一逻辑器件(6)，对逻辑信号(/D1)与脉冲信号(PULSE)进行逻辑组合，并输出置位信号(/SET)；第二逻辑器件(7)，对逻辑输入信号(/D)与互补脉冲信号(/PULSE)进行逻辑组合，并输出复位信号(/RES)；锁存器器件(14)，具有用于保持逻辑保持电平的存储装置(17，18，19)，由所述置位信号(/SET)控制的第一推挽式晶体管(15)能够将所述保持电平设置为第一逻辑电平(VDD)，由所述复位信号(/RES)控制的第二推挽式晶体管(16)能够将所述保持电平设置为第二逻辑电平(VSS)，所述保持电平能够作为所述逻辑信号(/D1)的已存储逻辑状态被送出。 | ||
| 搜索关键词： | 脉冲 静态 触发器 | ||
【主权项】：
1.一种脉冲静态触发器(1)，用于存储逻辑信号(/D1)的逻辑状态，所述触发器具有：a)第一逻辑器件(6)，对逻辑信号(/D1)与脉冲信号(PULSE)进行逻辑组合，并输出置位信号(/SET)；b)第二逻辑器件(7)，对逻辑输入信号(/D)与互补脉冲信号(/PULSE)进行逻辑组合，并输出复位信号(/RES)；c)锁存器器件(14)，具有用于保持逻辑保持电平的存储装置(17，18，19)，由所述置位信号(/SET)控制的第一推挽式晶体管(15)能够将所述保持电平设置为第一逻辑电平(VDD)，由所述复位信号(/RES)控制的第二推挽式晶体管(16)能够将所述保持电平设置为第二逻辑电平(VSS)，所述保持电平能够作为所述逻辑信号(/D1)的已存储逻辑状态被送出。
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