[发明专利]多阶层加速器架构的处理器系统及其操作方法有效
| 申请号： | 200610171715.9 | 申请日： | 2006-12-19 |
| 公开（公告）号： | CN1983166A | 公开（公告）日： | 2007-06-20 |
| 发明（设计）人： | 伊沃·图西克 | 申请（专利权）人： | 威盛电子股份有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F9/30 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 史新宏;邵亚丽 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种数字信号处理系统，以使处理器可对多个多阶层架构的加速器进行存取。该系统包括一主加速器耦接于一处理器与多个次加速器之间，该处理器可藉由传送一个仅包含主加速器识别码字段的指令对至少一个次加速器进行存取。主加速器根据储存在地址指针缓存器的地址选择至少一个次加速器中的一个。可存取的次加速器的数量依据地址指针缓存器的寻址能力决定，且不会影响处理器指令的编码空间。处理器也可利用指令中包含的立即值或偏移地址来更新或修改在地址指针缓存器的地址。 | ||
| 搜索关键词： | 阶层 加速器 架构 处理器 系统 及其 操作方法 | ||
【主权项】：
1.一种主加速器，桥接于一处理器与共享一通用指令集的多个次加速器之间，该主加速器包括：一地址指针缓存器，包含一地址，该地址的一个地址字段指向一选中的次加速器；以及一解码器，用以接收传送自该处理器的指令，以控制该地址指针缓存器。
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