[实用新型]对时子钟无效
| 申请号： | 200620030834.8 | 申请日： | 2006-07-27 |
| 公开（公告）号： | CN2935218Y | 公开（公告）日： | 2007-08-15 |
| 发明（设计）人： | 范新;刘冬梅;李庆华;雒国成;王慧 | 申请（专利权）人： | 河南思维自动化设备有限公司 |
| 主分类号： | G04C11/00 | 分类号： | G04C11/00;G04C11/04;G04G7/00;G07C5/00;G07C5/02 |
| 代理公司： | 郑州异开专利事务所 | 代理人： | 韩华 |
| 地址： | 450016河*** | 国省代码： | 河南;41 |
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| 摘要： | 本实用新型公开了一种对时子钟，包括电源电路、主处理器、复位电路、时间信息接收电路、对时电路、对时子钟与转储器的接口电路、液晶显示模块。本实用新型优点在于大大降低了时间误差，提供了一个精确的、标准的时间与列车运行监控记录装置进行对时，大大提高了列车监控、监测等设备的精度。本实用新型与标准母钟相互配合，共同构成一个完整的标准时间系统。 | ||
| 搜索关键词： | 时子钟 | ||
【主权项】：
1、一种对时子钟，包括电源电路、主处理器、复位电路、时间信息接收电路、对时电路、对时子钟与转储器的接口电路、液晶显示模块，其特征在于：A、所述电源电路，交流220V电压经变压器后变成9V交流电压，再经过整流、滤波后送稳压器，然后送到需要电源的元器件；B、所述主处理器，包括两个8位微处理器(U4、U1)；微处理器(U4)的P0口与图形液晶显示模块相连；微处理器(U4、U1)相互通过P1口相连并共用一个晶振；载波模块的R/T端与电源(VCC)相连，其接收端与微处理器(U1)相连；微处理器(U4)与集成电路(U3)相连；集成电路(U5)与微处理器(U4)相连。
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