[实用新型]一种可提高电源抑制比的D类功率放大器电路无效
| 申请号： | 200620047413.6 | 申请日： | 2006-11-01 |
| 公开（公告）号： | CN200962579Y | 公开（公告）日： | 2007-10-17 |
| 发明（设计）人： | 许刚 | 申请（专利权）人： | 捷顶微电子(上海)有限公司 |
| 主分类号： | H03F3/217 | 分类号： | H03F3/217;H03F1/30 |
| 代理公司： | 上海光华专利事务所 | 代理人： | 余明伟 |
| 地址： | 201203上海市浦东新*** | 国省代码： | 上海;31 |
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| 摘要： | 本实用新型涉及一种可提高电源抑制比的D类功率放大器电路，包括D类功率放大器及其驱动电路、电源，其特征在于：该电路还包括一压控延时电路以及一逻辑运算电路，输入信号并接压控延时电路的输入以及逻辑运算电路的一输入端，压控延时电路的输出接逻辑运算电路的另一输入端，逻辑运算电路的输出经功率放大器驱动电路后接D类功率放大器。其中，所述的压控延时电路为输出级的电源电压供电的线性延时电路；所述的逻辑运算电路为或门运算电路；所述的D类功率放大器为MOSFET功率开关管。本实用新型电路能有效提高电源抑制比，而且结构简单、稳定性高。 | ||
| 搜索关键词： | 一种 提高 电源 抑制 功率放大器 电路 | ||
【主权项】：
1、一种可提高电源抑制比的D类功率放大器电路，包括D类功率放大器及其驱动电路、电源，其特征在于：该电路还包括一压控延时电路以及一逻辑运算电路，输入信号并接压控延时电路的输入以及逻辑运算电路的一输入端，压控延时电路的输出接逻辑运算电路的另一输入端，逻辑运算电路的输出经功率放大器驱动电路后接D类功率放大器。
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