[发明专利]具有多个内部数据总线和存储器库交错的存储器装置和方法无效

专利信息
申请号: 200680005766.2 申请日: 2006-01-11
公开(公告)号: CN101310339A 公开(公告)日: 2008-11-19
发明(设计)人: 约瑟夫·M·杰德罗 申请(专利权)人: 美光科技公司
主分类号: G11C8/00 分类号: G11C8/00
代理公司: 北京律盟知识产权代理有限责任公司 代理人: 王允方;刘国伟
地址: 美国爱*** 国省代码: 美国;US
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摘要: 一种存储器装置和方法通过单向下游总线接收写入数据,并通过单向上游总线输出读取数据。所述下游总线耦合到一对内部写入数据总线,且所述上游总线耦合到一对内部读取数据总线。第一组多路复用器选择性地将所述内部写入数据总线中的每一者耦合到存储器单元的多个库中的任一者。类似地,第二组多路复用器选择性地将存储器单元的多个库中的每一者耦合到所述内部读取数据总线中的任一者。可在从所述库中的一者耦合读取数据的同时将写入数据耦合到所述库中的另一者。并且,写入数据可同时从各自的写入数据总线耦合到两个不同的库,且读取数据可同时从两个不同的库耦合到各自的读取数据总线。
搜索关键词: 具有 内部 数据 总线 存储器 交错 装置 方法
【主权项】:
1.一种存储器系统,其包括:存储器控制器,其具有多个输出端子和多个输入端子;至少一个存储器装置,其具有多个输出端子和多个输入端子,所述至少一个存储器装置包括:存储器单元的多个库,其可操作以响应于写入命令而存储写入数据,并响应于读取命令而输出读取数据;至少一对内部写入数据总线,其每一者将所述存储器装置的输入端子耦合到所述存储器单元的库中的每一者;至少一对内部读取数据总线,其每一者将所述存储器装置的输出端子耦合到所述存储器单元的库中的每一者,所述内部读取数据总线与所述内部写入数据总线隔离;写入数据选择电路,其耦合到所述内部写入数据总线和所述库中的每一者,所述写入数据选择电路可操作以选择性地将所述内部写入数据总线中的每一者耦合到所述库中的任一者;读取数据选择电路,其耦合到所述内部读取数据总线和所述库中的每一者,所述读取数据选择电路可操作以选择性地将所述库中的任一者耦合到所述内部读取数据总线中的每一者;寻址电路,其可操作以选择所述库中的一者用于读取或写入存储器存取,并选择所述选定库中的存储器单元行和列;以及命令解码器,其可操作以接收并解码存储器命令且产生对应于所述存储器命令的控制信号,所述控制信号中的至少一些控制信号对写入数据选择电路进行控制,以促使通过所述内部写入数据总线中的任一者将写入数据从所述存储器装置的输入端子耦合到选定的库,且所述控制信号中的至少一些控制信号控制所述读取数据选择电路,以促使将读取数据通过所述内部读取数据总线中的任一者从选定的库耦合到所述存储器装置的输入端子;下游总线,其将所述存储器控制器的输出端子耦合到所述存储器装置的输入端子,所述下游总线与所述存储器控制器的输入端子和所述存储器装置的输出端子隔离:以及上游总线,其将所述存储器装置的输出端子耦合到所述存储器控制器的输入端子,所述上游总线与所述存储器控制器的输出端子和所述存储器装置的输入端子隔离。
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