[发明专利]数据锁存器在非易失性存储器的多阶段编程中的使用有效

专利信息
申请号: 200680010776.5 申请日: 2006-03-27
公开(公告)号: CN101151678A 公开(公告)日: 2008-03-26
发明(设计)人: 李彦;若尔-安德里安·瑟尼 申请(专利权)人: 桑迪士克股份有限公司
主分类号: G11C16/34 分类号: G11C16/34
代理公司: 北京律盟知识产权代理有限责任公司 代理人: 刘国伟
地址: 美国加利*** 国省代码: 美国;US
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摘要: 一种非易失性存储器装置包含用于管制非易失性存储器中多阶段编程过程的电路。示范性实施例使用快速通过写入技术,其中使用单个编程通过,但改变选定存储器单元的偏压以随着所述存储器单元接近其目标值而通过升高所述选定存储器单元的沟道的电压电平来减慢编程。本发明的原理性方面引入与读取/写入电路相关联的锁存器,所述读取/写入电路可沿着相应位线连接到每一选定存储器单元以用于存储处于此较低电平的检验的结果。
搜索关键词: 数据 锁存器 非易失性存储器 阶段 编程 中的 使用
【主权项】:
1.一种非易失性存储器装置,其包括:一个或一个以上存储器单元,其每一者均能够存储N位数据,其中N大于或等于一;以及可连接到所述存储器单元的读取/写入电路,其包括:编程电路,用以向所述存储器单元施加单调地不减小的编程波形;偏压电路,用以在所述编程波形被施加到所述存储器单元的同时设定所述存储器单元中的偏压条件,其中在第一编程阶段期间使用第一组偏压条件且在第二编程阶段期间使用第二组偏压条件;以及一组或一组以上锁存器,其每一者均与所述存储器单元中与所述读取/写入电路连接的相应一者相关联,其中所述组锁存器中每一者的第一锁存器管制所述编程阶段中的哪一阶段有效。
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