[发明专利]到达时间锁定环路无效
| 申请号： | 200680024439.1 | 申请日： | 2006-05-04 |
| 公开（公告）号： | CN101213750A | 公开（公告）日： | 2008-07-02 |
| 发明（设计）人： | 文·T·林 | 申请（专利权）人： | 吉斯通半导体有限公司 |
| 主分类号： | H03L7/00 | 分类号： | H03L7/00;H03L7/06;H03D3/24 |
| 代理公司： | 上海智信专利代理有限公司 | 代理人： | 邓琪 |
| 地址： | 美国宾夕*** | 国省代码： | 美国;US |
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| 摘要： | 这个发明公开介绍了电路、系统和方法，以从基准信号源产生稳定的信号。这些新的发明远好于当前的技术，以提供具有更少相位噪声的稳定信号。这个新的发明也提供新的方法，以分析该反馈控制回路而不使用传统反馈控制理论。 | ||
| 搜索关键词： | 到达 时间 锁定 环路 | ||
【主权项】：
1.一种到达时间锁定回路，包括：一个到达时间检测器，具有至少连个输入端和一个输出端；一个回路滤波器，具有一个输入端和一个输出端，并且其中所述回路滤波器输入端与所述到达时间检测器的输出端连接；以及一个压控振荡器(VCO)，具有一个输入端和一个输出端，其中所述VCO输入端与所述回路滤波器的输出端连接，所述VCO的所述输出端与所述到达时间检测器输入端中的一个相连接。
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