[发明专利]高速比较器无效
| 申请号： | 200680040072.2 | 申请日： | 2006-10-16 |
| 公开（公告）号： | CN101297483A | 公开（公告）日： | 2008-10-29 |
| 发明（设计）人： | 弗朗切斯科·A·毛内 | 申请（专利权）人： | NXP股份有限公司 |
| 主分类号： | H03K5/24 | 分类号： | H03K5/24 |
| 代理公司： | 北京天昊联合知识产权代理有限公司 | 代理人： | 陈源;张天舒 |
| 地址： | 荷兰艾*** | 国省代码： | 荷兰;NL |
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| 摘要： | 一种比较器，包含差动放大器(T1，T2，T8，T9)，其具有形成比较器输入端的差动输入端(IN1，IN2)，和形成第一比较器级的比较器输出的第一和第二放大器输出(f1，f2)，其中，差动放大器具有第一(T1，T8)和第二(T2，T9)并联支路。该比较器具有：第一电流源电路(32)，其限定了要被驱动通过差动放大器的电流；第二电流源电路(34)，其包含由第一支路驱动的负载；以及第三电流源电路(36)，其包含由第二支路驱动的负载。电路(T6，T7)被提供用于在差动放大器处于提供差动输出的稳定状态时来限定第一放大器输出和第二放大器输出之间的电压差。这种装置驱动电流独立地通过两个支路，以便将每个支路中的主晶体管保持在导通状态，从而使能保证快速响应时间。通过固定输出之间的电压差，可以消除对差动放大器的共模电压的占空比的依赖。 | ||
| 搜索关键词： | 高速 比较 | ||
【主权项】：
1.一种比较器，其包括：差动放大器(T1，T2，T8，T9)，其具有形成比较器输入端的差动输入端(IN1，IN2)，和形成第一比较器级的比较器输出的第一和第二放大器输出(f1，f2)，其中，所述差动放大器具有第一并联支路(T1，T8)和第二并联支路(T2，T9)；第一电流源电路(32)，其限定了要被驱动通过所述差动放大器的电流；第二电流源电路(34)，其包含由所述第一支路驱动的负载；第三电流源电路(36)，其包含由所述第二支路驱动的负载；电路(T6，T7)，在所述差动放大器处于提供差动输出的稳定状态时，该电路用于限定所述第一放大器输出和所述第二放大器输出之间的电压差。
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