[发明专利]PLL控制电路无效
| 申请号： | 200680041091.7 | 申请日： | 2006-11-01 |
| 公开（公告）号： | CN101300739A | 公开（公告）日： | 2008-11-05 |
| 发明（设计）人： | 大月道仁;祐川正纯;岩崎充孝;塚越敏弘 | 申请（专利权）人： | 日本电气株式会社;株式会社理光 |
| 主分类号： | H03L7/14 | 分类号： | H03L7/14 |
| 代理公司： | 北京东方亿思知识产权代理有限责任公司 | 代理人： | 柳春雷 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 在响应参考时钟而输出PLL时钟的PLL控制电路中具有频率调节电路，该频率调节电路进行频率调节，以使PLL时钟的频率在参考时钟发生变动时也实质上保持恒定。该频率调节电路使确定PLL时钟的频率的计数器的设定值响应参考时钟频率的变动而变化。 | ||
| 搜索关键词： | pll 控制电路 | ||
【主权项】：
1.一种PLL控制电路，其特征在于，包括：计数器部，对PLL的输出频率进行变更控制；检测部，检测向所述PLL输入的参考时钟；以及设定变更部，基于所述检测部的检测结果来变更所述计数器部的设定值。
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