[发明专利]一种基于FPGA的动态可重构高性能运算方法与装置无效
| 申请号： | 200710018207.1 | 申请日： | 2007-07-09 |
| 公开（公告）号： | CN101086729A | 公开（公告）日： | 2007-12-12 |
| 发明（设计）人： | 苗保刚;张卫军;付国军;谢国鹏;郭忠峰;高兴利;梁光勤;张致远 | 申请（专利权）人： | 西安飞鹰科技有限责任公司 |
| 主分类号： | G06F15/17 | 分类号： | G06F15/17 |
| 代理公司： | 西安弘理专利事务所 | 代理人： | 罗笛 |
| 地址： | 710043陕西省西安*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明公开的一种基于FPGA的动态可重构高性能运算方法，采用至少一个计算单元HCU实现并行运算，并通过主控计算设备发送指令和参数，控制计算单元HCU的运行，并接收其运算结果，计算单元HCU的运算是采用至少两个大容量可编程门阵列FPGA进行基本计算逻辑的并行处理，并通过高速LVDS实现相互之间的数据传输，最终将大容量可编程门阵列FPGA的处理结果通过通讯接口传输出去。实现该方法的装置包括至少一个计算单元HCU、控制计算单元HCU运行的主控计算设备以及实现两者之间数据交换的通讯接口。本发明充分利用了大容量可编程门阵列FPGA的可重构特性和并行处理特性，将运算进行流水线和并行改造，实现了超高速处理的功能，又具有功耗低、体积小、计算成本低的特点。 | ||
| 搜索关键词： | 一种 基于 fpga 动态 可重构高 性能 运算 方法 装置 | ||
【主权项】：
1.一种基于FPGA的动态可重构高性能运算方法，其特征在于，该方法包括以下步骤，采用至少一个计算单元HCU实现并行的运算；将上步得到的每一个计算单元HCU的运算结果通过通讯接口传输给主控计算设备；主控计算设备发送指令和参数又通过通讯接口传输给每一个计算单元HCU，控制计算单元HCU的运行；所述计算单元HCU的运算是，采用至少两个大容量可编程门阵列FPGA进行基本计算逻辑的并行处理；将上步得到的每一个大容量可编程门阵列FPGA的处理结果以及运算参数和中间变量存储于与之对应相连接的外部RAM中，大容量可编程门阵列FPGA通过高速低压差分信号LVDS实现相互之间的数据传输；将最终的大容量可编程门阵列FPGA的处理结果通过通讯接口传输出去。
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