[发明专利]叠层布线和利用该叠层布线的半导体器件及其制造方法有效
申请号: | 200710088746.2 | 申请日: | 2007-03-22 |
公开(公告)号: | CN101043049A | 公开(公告)日: | 2007-09-26 |
发明(设计)人: | 田中淳;加纳博司 | 申请(专利权)人: | 日本电气株式会社;NEC液晶技术株式会社 |
主分类号: | H01L29/49 | 分类号: | H01L29/49;H01L29/786;H01L23/532;H01L21/28;H01L21/336;H01L21/768 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 梁晓广;陆锦华 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 提供一种由微晶硅薄膜和金属薄膜构成的叠层布线,该叠层布线能够抑制微晶硅薄膜和金属薄膜之间的过多硅化物生成反应,由此防止发生薄膜脱落。在利用叠层布线的多晶硅TFT(薄膜晶体管)中,微晶硅薄膜被构造,使得微晶硅薄膜中的、在微晶硅薄膜的膜厚度方向上的长度为微晶硅薄膜的膜厚度的60%或更大的晶粒,总计为晶粒总数的15%或更少;或者使得微晶硅薄膜中的、在微晶硅薄膜的膜厚度方向上的长度为微晶硅薄膜的膜厚度的50%或更小的晶粒,总计为构成微晶硅薄膜的晶粒总数的85%或更多。 | ||
搜索关键词: | 布线 利用 半导体器件 及其 制造 方法 | ||
【主权项】:
1.一种叠层布线,包括:微晶硅薄膜;以及在所述微晶硅薄膜上形成的金属薄膜,其中构成所述微晶硅薄膜的晶体结构的、在所述微晶硅薄膜的膜厚度方向上的长度为所述微晶硅薄膜的膜厚度的60%或更大的晶粒,总计为晶粒总数的15%或更少。
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