[发明专利]片上网络数字路由器及其并行数据传输方法无效
申请号: | 200710113142.9 | 申请日: | 2007-10-10 |
公开(公告)号: | CN101141261A | 公开(公告)日: | 2008-03-12 |
发明(设计)人: | 曾凡太 | 申请(专利权)人: | 山东大学 |
主分类号: | H04L12/02 | 分类号: | H04L12/02;H04L12/56 |
代理公司: | 济南金迪知识产权代理有限公司 | 代理人: | 许德山 |
地址: | 250100山东*** | 国省代码: | 山东;37 |
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摘要: | 本发明涉及一种片上网络数字路由器及其并行数据传输方法,也称为数字万向节,属于大规模集成电路设计领域。片上网络并行数字路由器其特征在于:它是由先进先出行波移位缓冲存储器(FIFO)、同步矩阵开关阵列、路由决策模块、并行网络接口汇集在集成电路芯片上和它的不同于传统网络的并行数据传输方法。本发明的优点:1.解决了片上总线随处理器增多而产生的数据传输拥塞问题。2.网络并行数据传输方法提高了数据传输速率,减少了并串转换所需要的时间、资源。加快了处理器之间的数据通信的速度,提高了片上多处理器间协同工作的能力。 | ||
搜索关键词: | 网络 数字 路由器 及其 并行 数据传输 方法 | ||
【主权项】:
1.一种片上网络并行数字路由器,其特征在于它是在集成电路芯片上由先进先出行波移位缓冲存储器(FIFO)、在先进先出行波移位缓冲存储器(FIFO)两边的两组同步矩阵开关阵列、路由决策模块、并行网络接口汇集而成,并行网络接口输入端口与同步矩阵开关阵列相连接;在存储器一边的同步矩阵开关阵列的输出接口和先进先出行波移位缓冲存储器(FIFO)输入接口相连,先进先出行波移位缓冲存储器(FIF0)的输出接口与另一边同步矩阵开关阵列连接,通过同步矩阵开关阵列连接到并行网络接口;路由决策模块包括报头寄存器和状态标志寄存器,其接口含有命令输出接口,路由决策模块中的报头寄存器和状态标志寄存器通过报头数据和状态输入线与FIFO相连,路由决策模块的命令输出接口和同步矩阵开关的命令接收译码模块相连,利用命令接收译码模块实现路由决策模块的控制意图。
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