[发明专利]在半导体器件上形成电感器的方法无效
申请号: | 200710138239.5 | 申请日: | 2007-07-31 |
公开(公告)号: | CN101118872A | 公开(公告)日: | 2008-02-06 |
发明(设计)人: | 黃祥逸;郑石源 | 申请(专利权)人: | 东部高科股份有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 隆天国际知识产权代理有限公司 | 代理人: | 郑小军 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | 一种在半导体器件上形成电感器的方法,包括在硅半导体衬底上顺序形成防蚀膜、第一层间绝缘膜和具有第一孔的第一硬掩模薄膜;在第一硬掩模薄膜上形成第二层间绝缘膜;在第二层间绝缘膜上形成第二硬掩模薄膜;在第二硬掩模薄膜上形成具有用于形成开口的沟槽的光致抗蚀剂图案;去除部分第二硬掩模薄膜和部分第二层间绝缘膜,在第二层间绝缘膜上形成第一沟槽;去除光致抗蚀剂图案和第一沟槽中产生的聚合物;蚀刻第二层间绝缘膜,暴露出第一硬掩模薄膜,在第二层间绝缘膜上形成第二沟槽,蚀刻第一层间绝缘膜,暴露出防蚀膜,在第一层间绝缘膜上形成第二孔;去除第二沟槽和第二孔中产生的聚合物。该方法有效去除UTM蚀刻工艺期间产生的大量聚合物。 | ||
搜索关键词: | 半导体器件 形成 电感器 方法 | ||
【主权项】:
1.一种在半导体器件中形成电感器的方法,所述方法包括:在硅半导体衬底上顺序形成防蚀膜、第一层间绝缘膜、以及第一硬掩模薄膜;选择性蚀刻所述第一硬掩模薄膜以形成第一孔;在所述第一硬掩模薄膜上形成第二层间绝缘膜;在所述第二层间绝缘膜上形成第二硬掩模薄膜;在所述第二硬掩模薄膜上形成光致抗蚀剂图案,所述光致抗蚀剂图案具有用于形成沟槽的开口;通过使用所述光致抗蚀剂图案作为蚀刻掩模来去除部分所述第二硬掩模薄膜和部分所述第二层间绝缘膜,以在所述第二层间绝缘膜上形成第一沟槽;去除所述光致抗蚀剂图案和在所述第一沟槽中产生的聚合物;通过使用所述第二硬掩模薄膜作为蚀刻掩模来蚀刻所述第二层间绝缘膜,直到所述第一硬掩模薄膜被暴露出来,以在所述第二层间绝缘膜上形成第二沟槽,随后,通过使用所述第一硬掩模薄膜和所述第二硬掩模薄膜作为蚀刻掩模来蚀刻所述第一层间绝缘膜,直到所述防蚀膜被暴露出,以在所述第一层间绝缘膜上形成第二孔;以及去除在所述第二沟槽和所述第二孔中产生的聚合物。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造