[发明专利]高速前侧总线的物理接口结构有效
| 申请号： | 200710192750.3 | 申请日： | 2007-11-16 |
| 公开（公告）号： | CN101201809A | 公开（公告）日： | 2008-06-18 |
| 发明（设计）人： | S·J·鲍姆加特纳;A·R·邦纳奇奥;T·C·巴克霍尔兹;D·M·德雷普斯;C·P·吉尔;M·梅格赫利;S·V·赖洛夫;D·W·西尔詹伯格;D·M·沃斯特 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06F15/163 | 分类号： | G06F15/163 |
| 代理公司： | 北京市金杜律师事务所 | 代理人： | 冯谱 |
| 地址： | 美国纽*** | 国省代码： | 美国;US |
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| 摘要： | 一种高速计算机处理器系统，包括用于图形处理器的高速接口。在一个优选实施例中，该高速接口包括一个前侧总线(FSB)，其接口连接到图形处理器上的类似的高速接口。 | ||
| 搜索关键词： | 高速 总线 物理 接口 结构 | ||
【主权项】：
1.一种计算机系统，包括：中央处理单元(CPU)，具有连接到一个通道的CPU前侧总线(FSB)；图形处理单元(GPU)，具有连接到该通道的GPU FSB；以及其中该CPU FSB包括一个物理层，其从连接到该通道的多个接收机内核接收并行数据输入，并且其中该接收机内核包括：时钟片模块，具有一个模拟部分和一个数字部分，其中该模拟部分包括：滤波器，其产生未旋转的同相时钟(I)和正交时钟(Q)；相位旋转器，用于产生由抖动控制逻辑控制的旋转的I和Q时钟；和复用器，用于在该未旋转的I和Q时钟和该旋转的I和Q时钟之间选择以输出未旋转的或旋转的I和Q时钟；多个数据片模块，其具有一个模拟部分和一个数字部分；以及时钟分配模块，其将该选择的旋转的或未旋转的I和Q时钟从该复用器的输出分配到该数据片模块的每一个副本。
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