[发明专利]多芯片封装及其方法无效
申请号: | 200710196995.3 | 申请日: | 2007-12-07 |
公开(公告)号: | CN101197360A | 公开(公告)日: | 2008-06-11 |
发明(设计)人: | 杨文焜 | 申请(专利权)人: | 育霈科技股份有限公司 |
主分类号: | H01L25/00 | 分类号: | H01L25/00;H01L25/065;H01L23/538;H01L21/50;H01L21/60 |
代理公司: | 中科专利商标代理有限责任公司 | 代理人: | 周长兴 |
地址: | 台湾省*** | 国省代码: | 中国台湾;71 |
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摘要: | 一种多芯片封装结构,包含具有于其上表面内的晶粒接收凹处以及穿过其中的第一穿孔结构的基板,而具有端点垫的电路则形成于第一穿孔结构之下。第一晶粒位于晶粒接收凹处内,第一介电层则形成于第一晶粒以及基板上。第一重分布层形成于第一介电层上,并经由第一穿孔结构耦合至第一晶粒与该端点垫,第二介电层具有形成于第一重分布层上的开口,第二晶粒则附着于第二介电层上。围绕第二晶粒的围绕材料具有对准此开口的第二穿孔结构,第三介电层形成于第二晶粒以及围绕材料上。第二重分布层形成于第三介电层上,并经由第二穿孔结构耦合至第二晶粒的结合垫以及端点垫,保护层则形成于第二重分布层上。 | ||
搜索关键词: | 芯片 封装 及其 方法 | ||
【主权项】:
1.一种多芯片封装结构,其特征为包含:一基板,具有于其上表面内的晶粒接收凹处以及穿过其中的第一穿孔结构,而具有端点垫的电路则形成于该第一穿孔结构之下;一第一晶粒,位于该晶粒接收凹处内;一第一介电层,形成于该第一晶粒以及该基板上;一第一重分布层,形成于该第一介电层上,并经由该第一穿孔结构耦合至该第一晶粒与该端点垫;一第二介电层,具有形成于该第一重分布层上的开口;一第二晶粒,附着于该第二介电层上;一围绕材料,围绕该第二晶粒,并具有对准该开口的第二穿孔结构;一第三介电层,形成于该第二晶粒以及该围绕材料上;一第二重分布层,形成于该第三介电层上,并经由该第二穿孔结构耦合至该第二晶粒以及该端点垫;以及一保护层,形成于该第二重分布层上。
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