[实用新型]一种微控制器有效
申请号: | 200720177185.9 | 申请日: | 2007-09-25 |
公开(公告)号: | CN201083993Y | 公开(公告)日: | 2008-07-09 |
发明(设计)人: | 岳卫杰;张继文;潘松;陈光胜 | 申请(专利权)人: | 上海海尔集成电路有限公司 |
主分类号: | G05B19/04 | 分类号: | G05B19/04 |
代理公司: | 北京同立钧成知识产权代理有限公司 | 代理人: | 刘芳 |
地址: | 200030上海市中*** | 国省代码: | 上海;31 |
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摘要: | 本实用新型涉及一种微控制器,包括:内核,包括中央处理单元、存储器、时钟发生器和指令预处理模块,其中,存储器包括程序存储器和数据存储器,程序存储器、数据存储器和时钟发生器均与中央处理单元相连,指令预处理模块与时钟发生器相连;一个以上外设单元,通过系统总线与内核相连;一个以上功能部件,通过控制总线与中央处理单元相连。上述微控制器具有较好的抗干扰能力、存储容量大、运行速度快,并且具有较完备的外设和大量功能部件,具有较好的灵活性和可靠性。 | ||
搜索关键词: | 一种 控制器 | ||
【主权项】:
1.一种微控制器,其特征在于包括:内核,包括中央处理单元、存储器、时钟发生器和指令预处理模块,其中,存储器包括程序存储器和数据存储器,指令预处理模块包括指令寄存器、指令译码器、端口预处理器、中断处理器、多路器和立即数处理器,程序存储器、数据存储器和时钟发生器均与中央处理单元相连,指令预处理模块与时钟发生器相连,指令寄存器和指令译码器通过程序总线相连,多路器和立即数处理器通过数据总线相连,端口预处理器与系统总线相连,中断处理器与地址总线相连;一个以上外设单元,通过系统总线与内核相连;一个以上功能部件,通过控制总线与中央处理单元相连。
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