[发明专利]基于区块的分支目标地址高速缓冲存储器无效
| 申请号： | 200780016471.X | 申请日： | 2007-04-23 |
| 公开（公告）号： | CN101438237A | 公开（公告）日： | 2009-05-20 |
| 发明（设计）人： | 罗德尼·韦恩·史密斯;詹姆斯·诺里斯·迪芬德尔夫尔;托马斯·安德鲁·萨托里乌斯 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 | 代理人： | 刘国伟 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明提供一种分支目标地址高速缓冲存储器(BTAC)，其存储多个条目，每一BTAC条目与具有两个或两个以上指令的区块相关联，所述区块包括已被评估为被采纳的至少一个分支指令。所述BTAC条目包括指示所述相关联区块内的哪个指令是被采纳分支指令的指示符。所述BTAC条目还包括所述被采纳分支的分支目标地址(BTA)。区块大小可(但未必)对应于每个指令高速缓冲存储器线的指令数目。 | ||
| 搜索关键词： | 基于 区块 分支 目标 地址 高速 缓冲存储器 | ||
【主权项】：
1. 一种在处理器中预测分支指令的方法，其包含：将条目存储于分支目标地址高速缓冲存储器(BTAC)中，所述BTAC条目与具有两个或两个以上指令的区块相关联，所述区块包括已被评估为被采纳的至少一个分支指令；和在取出一群组指令后，存取所述BTAC以确定所述对应区块中的指令是否为被采纳分支指令。
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