[发明专利]半导体器件及其制造方法有效
申请号: | 200810004928.1 | 申请日: | 2008-01-29 |
公开(公告)号: | CN101252133A | 公开(公告)日: | 2008-08-27 |
发明(设计)人: | 山田哲也 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L23/522;H01L21/8247;H01L21/768 |
代理公司: | 隆天国际知识产权代理有限公司 | 代理人: | 张龙哺;冯志云 |
地址: | 日本神奈*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供一种半导体器件及其制造方法。该制造方法包括以下步骤:形成设置有浮栅、中间绝缘膜、及控制栅的闪存单元;形成第一杂质扩散区和第二杂质扩散区;将硅衬底和浮栅的表面热氧化;经由光致抗蚀剂图案的窗口蚀刻部分区域中的隧道绝缘膜;在部分区域中的第一杂质扩散区上形成金属硅化物层;形成覆盖闪存单元的层间绝缘膜;以及在层间绝缘膜的第一孔中形成连接到金属硅化物层的导电插塞。本发明能够防止器件隔离绝缘膜在蚀刻热绝缘膜时被蚀刻。 | ||
搜索关键词: | 半导体器件 及其 制造 方法 | ||
【主权项】:
1.一种半导体器件,包括:半导体衬底;第一杂质扩散区和第二杂质扩散区,彼此间隔地形成于所述半导体衬底的表面层中;热氧化膜,至少形成于所述第一杂质扩散区和所述第二杂质扩散区上以及位于所述第一杂质扩散区和第二杂质扩散区之间的所述半导体衬底上;闪存单元,是通过在所述热氧化膜上依次叠置由第一导电膜形成的浮栅、中间绝缘膜、由第二导电膜形成的控制栅而形成,并且所述闪存单元将所述第一杂质扩散区和所述第二杂质扩散区用作源/漏区;层间绝缘膜,覆盖所述闪存单元,并且设置有位于所述第一杂质扩散区之上的第一孔;以及第一导电插塞,形成于所述第一孔中,其中,从所述第一杂质扩散区的部分区域除去所述热氧化膜;在所述第一杂质扩散区的所述部分区域上形成有金属硅化物膜,并且所述金属硅化物层与所述导电插塞连接。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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