[发明专利]用于可编程逻辑集成电路器件的低功率收发器结构无效
| 申请号： | 200810091499.6 | 申请日： | 2008-04-21 |
| 公开（公告）号： | CN101291148A | 公开（公告）日： | 2008-10-22 |
| 发明（设计）人： | S·舒马拉耶夫;W·翁;T·T·黄;T·M·德兰;R·G·克利夫 | 申请（专利权）人： | 阿尔特拉公司 |
| 主分类号： | H03K19/177 | 分类号： | H03K19/177 |
| 代理公司： | 北京纪凯知识产权代理有限公司 | 代理人： | 赵蓉民 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 可编程逻辑器件集成电路(“PLD”)上的高速串行接口或收发器电路包括允许所述PLD满足宽范围的可能的用户需求或应用的特征。该范围包括高性能应用和降低PLD的功率损耗是重要的应用。在后面的情形中，任何一个或一个以上的各种特征可用于帮助降低功率损耗。 | ||
| 搜索关键词： | 用于 可编程 逻辑 集成电路 器件 功率 收发 结构 | ||
【主权项】：
1.一种可编程逻辑器件集成电路，其包括：核心电路；和高速串行接口电路，其包括：物理介质连接PMA电路；协议编码子层PCS电路，其处理在所述PMA电路与所述核心电路之间传输中的信号；和旁路电路，其选择性地允许信号在所述PMA电路和所述核心电路之间不通过所述PCS电路传递。
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