[发明专利]除法电路有效
| 申请号： | 200810108561.8 | 申请日： | 2008-05-27 |
| 公开（公告）号： | CN101324836A | 公开（公告）日： | 2008-12-17 |
| 发明（设计）人： | 本田岩 | 申请（专利权）人： | 三洋电机株式会社;三洋半导体株式会社 |
| 主分类号： | G06F7/52 | 分类号： | G06F7/52 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 李香兰 |
| 地址： | 日本国大阪府守*** | 国省代码： | 日本;JP |
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| 摘要： | 一种除法电路，是以除数除被除数的除法电路，具备：倍除数生成电路，其生成从除数的2倍到2m－1(m是2以上的整数)倍的2m－2个作为除数的倍数的倍除数；和商生成电路，其通过从被除数分别减去除数及2m－2个倍除数，使得针对被除数的商从上位开始按每m位顺次生成。由此，可高速执行除法处理。 | ||
| 搜索关键词： | 除法 电路 | ||
【主权项】：
1、一种除法电路，是以除数除被除数的除法电路，具备：倍除数生成电路，其生成从所述除数的2倍到2m-1倍的2m-2个作为所述除数的倍数的倍除数，其中，m是2以上的整数；和商生成电路，其通过从所述被除数分别减去所述除数及2m-2个所述倍除数，使得针对所述被除数的商从上位起按每m位顺次生成。
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