[发明专利]一种金融税控SOC芯片逻辑验证系统无效
| 申请号： | 200810139876.9 | 申请日： | 2008-09-22 |
| 公开（公告）号： | CN101377794A | 公开（公告）日： | 2009-03-04 |
| 发明（设计）人： | 于治楼;姜凯;梁智豪 | 申请（专利权）人： | 浪潮电子信息产业股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 济南信达专利事务所有限公司 | 代理人： | 姜明 |
| 地址： | 250014山东*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明提供一种金融税控SOC芯片逻辑验证系统，该系统是利用现场可编程门阵列FPGA搭建一个金融税控SOC芯片逻辑验证系统，系统包括软件平台和硬件平台，硬件平台包括由现场可编程门阵列FPGA作模型的载体的芯片逻辑验证模型、各类功能模块及其接口模块，其中功能模块及其接口模块与芯片逻辑验证模型相连，软件平台用来实现对芯片逻辑验证模型、功能模块及其接口模块的配置和相关数据处理，并将信号输入到接口模块，通过各个功能模块产生芯片逻辑验证模型的输入信号，通过芯片逻辑验证模型产生对软件的控制信号，通过各个功能模块及其接口模块转化为软件显示标量。 | ||
| 搜索关键词： | 一种 金融 soc 芯片 逻辑 验证 系统 | ||
【主权项】：
1、一种金融税控SOC芯片逻辑验证系统，是利用现场可编程门阵列FPGA搭建一个金融税控SOC芯片逻辑验证系统，其特征在于：该系统包括软件平台和硬件平台，硬件平台包括由现场可编程门阵列FPGA作模型的载体的芯片逻辑验证模型、各类功能模块及其接口模块，其中功能模块及其接口模块与芯片逻辑验证模型相连，软件平台用来实现对芯片逻辑验证模型、功能模块及其接口模块的配置和相关数据处理，并将信号输入到接口模块，通过各个功能模块产生芯片逻辑验证模型的输入信号，通过芯片逻辑验证模型产生对软件的控制信号，通过各个功能模块及其接口模块转化为软件显示标量。
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