[发明专利]高效迭代解码无效
申请号: | 200810191100.1 | 申请日: | 1999-11-04 |
公开(公告)号: | CN101505156A | 公开(公告)日: | 2009-08-12 |
发明(设计)人: | H·H·哈勒;J·M·施泰因 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | H03M13/29 | 分类号: | H03M13/29;H03M13/45 |
代理公司: | 上海专利商标事务所有限公司 | 代理人: | 陈 炜 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | 一种装置,用于对根据多分量编码方案编码的信号分组的序列进行迭代解码。所述装置包括多个解码器(68、70),每个解码器在信号分组中的一个信号分组上执行相应的不同解码方法,致使多个解码器基本上同时操作。如果到达最大迭代次数预定门限值,或如果以前两个解码器迭代已经满足循环冗余校验(CRC),或如果已使输入帧缓冲器充满到它的存储容量的预定百分比之内,则可以终止迭代解码。 | ||
搜索关键词: | 高效 解码 | ||
【主权项】:
1. 一种装置,用于对根据多分量编码方案编码的信号分组的序列进行迭代解码,所述装置包括:多个缓冲器,所述多个缓冲器的每一个被配置为从所述的分组的序列接收一个分组;多个存储器单元;以及多个解码器,所述多个解码器与所述多个缓冲器个数是相等的,其中每两个相继的解码器与一个不同的存储器单元有关;所述多个解码器的每一个被配置为执行各自不同的解码方法;以及所述解码器中的第一解码器被配置为在一系列操作循环中顺次地接收所述缓冲器中一个缓冲器在一个输入上的内容;以及其中,每一个所述存储器单元被配置为:在一个操作循环中,接收来自所述多个解码器的一个解码器的输出到该存储器单元的第一部分中并提供该存储器单元的第二部分的内容到另一个所述解码器的输入中,在下一个操作循环中,接收来自所述多个解码器的所述一个解码器的输出到该存储器单元的第二部分中并提供该存储器单元的第一部分的内容到另一个所述解码器的输入中。
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