[发明专利]SoC布局的平面布图规划方法无效
| 申请号： | 200810201304.9 | 申请日： | 2008-10-16 |
| 公开（公告）号： | CN101369294A | 公开（公告）日： | 2009-02-18 |
| 发明（设计）人： | 陈珊珊;王琳凯;周晓方 | 申请（专利权）人： | 复旦大学 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 上海东亚专利商标代理有限公司 | 代理人： | 蒋支禾 |
| 地址： | 200433*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明基于B*－tree的表示法和模拟退火算法提出了SoC布局的平面布图规划方法，本方法用于实现SoC平面布局中不同种类模块混合布局的约束，针对实际布局中的连接关系、功耗满足、电源网络构建等要求而实现的SoC混合布局约束要求；本发明提出的SoC约束的布局，与传统在模拟退火中增加函数惩罚项的做法相比更为快速有效，不仅节省了运算时间而且提高了面积利用率。 | ||
| 搜索关键词： | soc 布局 平面 规划 方法 | ||
【主权项】：
1.一种SoC布局的平面布图规划方法，其特征在于：它采取将芯片中所有的标准单元抽象成宏模块Ms后的布局优化基本操作算法，其步骤是：a.随机构造一个允许的初始布局结构；b.针对得到的初始布局，在对B*-tree的基本操作过程中对目标函数进行优化，同时保证优化过程中的布图都是允许的。
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