[发明专利]基于分数输入和输出相位而操作的数字锁相环有效
| 申请号： | 200880118247.6 | 申请日： | 2009-01-12 |
| 公开（公告）号： | CN101878594A | 公开（公告）日： | 2010-11-03 |
| 发明（设计）人： | 加里·约翰·巴兰坦;孙博 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H03L7/085 | 分类号： | H03L7/085 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 刘国伟 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 在一个方面中，数字PLL(DPLL)基于输入和输出相位的分数部分而操作。所述DPLL累加至少一个输入信号以获得输入相位。所述DPLL(例如)使用时间/数字转换器(TDC)基于来自振荡器的振荡器信号与参考信号之间的相位差来确定输出相位的分数部分。所述DPLL基于所述输入相位的所述分数部分和所述输出相位的所述分数部分来确定相位误差。所述DPLL接着基于所述相位误差而产生用于所述振荡器的控制信号。在另一方面中，DPLL包括合成累加器，所述合成累加器基于所述参考信号通过追踪振荡器信号周期的数目来确定粗略输出相位。 | ||
| 搜索关键词： | 基于 分数 输入 输出 相位 操作 数字 锁相环 | ||
【主权项】：
一种设备，其包含：数字锁相环(DPLL)，其经配置以接收来自振荡器的振荡器信号，仅基于输入相位的分数部分和输出相位的分数部分来确定相位误差，且基于所述相位误差而产生用于所述振荡器的控制信号。
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