[发明专利]混数进制、进位行笔算数字工程方法无效
| 申请号： | 200910007942.1 | 申请日： | 2009-02-28 |
| 公开（公告）号： | CN101819514A | 公开（公告）日： | 2010-09-01 |
| 发明（设计）人： | 李志中;徐菊园 | 申请（专利权）人： | 李志中 |
| 主分类号： | G06F7/49 | 分类号： | G06F7/49 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 210016 江苏省南京市*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明涉及数字工程方法和笔算工程领域，提出一种新的数字工程方法。依据该“混数进制、进位行笔算数字工程方法”进行总体设计的笔算工程，能够显著提高笔算工程的运算速度，而且大大降低笔算的出错率。本发明将输入的进行加减的K个普通Q进制数，转换成K或2K个混数进制数。然后，对K或2K个混数进制数进行混数进制求和。从最低位开始或各位同时“按位加”，“按位和”数存入下一运算层；同时所得“混数进位”，则存放到下一运算层或本运算层尚未运算过的，任一数据行相邻高位的空位或0位处。经过如此反复运算，直至运算层中运算后不产生进位为止。则最后输出数，即为所求混数进制加法和数。 | ||
| 搜索关键词： | 混数进制 进位 行笔 算数 工程 方法 | ||
【主权项】：
一种笔算数字工程方法，采用混数进制和进位行逻辑结构，其中运载着混数进制数，以“混数进制、进位行笔算笔算数字工程方法”来进行运算：①输入K个普Q进制数到输入寄存器网(101)中；②在输入数码转换器网(102)中，将普Q进制数编码或另行转换为混数进制数；③在混数进制运算器(103)中，进行混数进制运算(“对冲”、“划Q”、“累加”)；④在输出数码转换器(104)中，将运算结果混数进制数译码或另行转换为普Q进制数；⑤经输出寄存器(105)输出普Q进制数；或者，①直接输入K或2K个混数进制数，到混数进制运算器(103)中；②在混数进制运算器(103)中，进行混数进制运算(“对冲”、“划Q”、“累加”)；运算结果混数进制数直接输出。
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