[发明专利]一种基于并行处理的多主机接口冗余SAN控制器无效
| 申请号： | 200910016156.8 | 申请日： | 2009-06-12 |
| 公开（公告）号： | CN101576805A | 公开（公告）日： | 2009-11-11 |
| 发明（设计）人： | 金长新;刘强;李伟;田凯 | 申请（专利权）人： | 浪潮电子信息产业股份有限公司 |
| 主分类号： | G06F3/06 | 分类号： | G06F3/06;G06F11/07;G06F13/40 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 250014山东*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明公开了一种基于并行处理的多主机接口冗余SAN控制器，属于一种控制器，其结构包括控制器冗余模块A、控制器冗余模块B及背板模块C，其中控制器冗余模块A与控制器冗余模块B通过高速PCIE总线P1连接，控制器冗余模块A与背板模块C通过非高速互联通路PA连接，控制器冗余模块B与背板模块C通过非高速互联通路PB连接。本发明的一种基于并行处理的多主机接口冗余SAN控制器和现有技术相比，采用双控制器双DMA通道并行处理，架构配备两个冗余控制器模块，在每个控制器冗余模块内部以及两个控制器冗余模块之间可以进行RAID等数据的并行处理，在不失可靠性的前提下可以大大提高控制器的整机性能。 | ||
| 搜索关键词： | 一种 基于 并行 处理 主机 接口 冗余 san 控制器 | ||
【主权项】：
1、一种基于并行处理的多主机接口冗余SAN控制器，其特征在于结构包括控制器冗余模块A、控制器冗余模块B及背板模块C，其中控制器冗余模块A与控制器冗余模块B通过高速PCIE总线P1连接，控制器冗余模块A与背板模块C通过非高速互联通路PA连接，控制器冗余模块B与背板模块C通过非高速互联通路PB连接；控制器冗余模块A及控制器冗余模块B结构相同，控制器冗余模块A包括主机接口A0、RAID控制器A1、RAID控制器A2以及磁盘控制器A3；控制器冗余模块B包括主机接口B0、RAID控制器B1、RAID控制器B2以及磁盘控制器B3；背板模块C包括硬盘接口、电源接口、磁盘阵列以及冗余控制切换电路；控制器冗余模块A和控制器冗余模块B的切换是通过背板模块C中的冗余控制切换电路实现。
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