[发明专利]一种现场可编程逻辑阵列的通用互连盒结构及建模方法有效

专利信息
申请号: 200910050942.X 申请日: 2009-05-11
公开(公告)号: CN101888240A 公开(公告)日: 2010-11-17
发明(设计)人: 王伶俐;周学功;来金梅;童家榕 申请(专利权)人: 复旦大学
主分类号: H03K19/177 分类号: H03K19/177
代理公司: 上海正旦专利代理有限公司 31200 代理人: 包兆宜
地址: 20043*** 国省代码: 上海;31
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摘要: 发明属于可编程器件结构技术领域,具体涉及一种现场可编程逻辑阵列(FPGA)的通用互连盒(GRB)结构。本发明GRB结构不仅提供了水平互连资源与垂直互连资源之间的连接,也提供了CLB/IOB同互连资源的连接以及CLB/IOB管脚之间的直接连接。与现有技术普遍使用的VPR工具所描述CB/SB布线结构以及CS-box结构相比,本通用开关盒能够更好地提高FPGA性能。实验结果表明,具有GRB结构的FPGA同CB/SB结构FPGA相比,在增加10.9%的开关使用情况下,能得到17.5%性能上的优化。
搜索关键词: 一种 现场 可编程 逻辑 阵列 通用 互连 结构 建模 方法
【主权项】:
一种现场可编程逻辑阵列的通用互连盒结构,其特征在于其结构由以下参数确定:(1).Fc_input,拥有四个元素的元组,(fc1,fc2,fc3,fc4),fci表示一个输入引脚能够连接GRB第i边上线段的比例,其中0≤fci≤1,1≤i≤4;(2).Fc_output,拥有四个元素的元组,(fc1,fc2,fc3,fc4),fci表示一个输出引脚能够连接GRB第i边上线段的比例,其中0≤fci≤1,1≤i≤4;(3).Fc_pad,拥有四个元素的元组,(fc1,fc2,fc3,fc4),fci表示一个IO管脚能够连接GRB第i边上线段的比例,其中0≤fci≤1,1≤i≤4;(4).Fc_output_with_lb_input,该参数描述“快线”连接的灵活性,表示对于一个逻辑块输出引脚能够驱动所有其邻接模块的输入引脚的比例;(5).Fc_output_with_pad_input,与Fc_output_with_lb_input类似,该参数表示了一个逻辑块输出引脚能够驱动所有邻接IO管脚的比例。
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