[发明专利]安全计算机3取2表决方法硬件平台无效
申请号: | 200910155630.5 | 申请日: | 2009-12-18 |
公开(公告)号: | CN101710376A | 公开(公告)日: | 2010-05-19 |
发明(设计)人: | 陈祥献;黄海 | 申请(专利权)人: | 浙江大学 |
主分类号: | G06F21/02 | 分类号: | G06F21/02;G06F11/16 |
代理公司: | 杭州天勤知识产权代理有限公司 33224 | 代理人: | 马士林 |
地址: | 310027 浙*** | 国省代码: | 浙江;33 |
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摘要: | 本发明公开了一种安全计算机3取2表决方法硬件平台,该平台包括:三个独立的CPU模块、I/O模块和通讯模块,每个I/O模块内部由互相独立的三个通道组成,并在内部完成“3取2”硬件表决,每个I/O模块和通信模块由主备两个模块并构成热备;三个CPU模块之间的通信采用基于LVDS的高速串行总线,每个CPU模块与I/O模块的通信采用独立的CAN总线,每个CPU模块与通信模块的通信采用以太网,平台与外部的通信由通信模块的两路冗余以太网实现;所有模块均具有热插拔功能。本发明保证了“3取2”表决的实时高速数据交换,在紧凑性结构的条件下提高了可靠性、可用性、可维护性和可扩展性,具有广泛的推广应用前景。 | ||
搜索关键词: | 安全 计算机 表决 方法 硬件 平台 | ||
【主权项】:
一种安全计算机3取2表决方法硬件平台,由CPU模块、通信模块和I/O模块构成,其特征在于:(1)所述CPU模块为三个独立的CPU模块,所述通信模块由主备两个模块组成的热备的结构形式,所述I/O模块由主备两个模块组成的热备的结构形式;(2)所述CPU模块之间采用CPU总线进行同步、数据交换和表决,所述CPU模块与通信模块之间采用通信总线进行数据传输,所述CPU模块与I/O模块之间采用I/O总线进行数据传输。
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