[发明专利]数据处理装置无效
| 申请号： | 200910160920.9 | 申请日： | 2009-07-24 |
| 公开（公告）号： | CN101661435A | 公开（公告）日： | 2010-03-03 |
| 发明（设计）人： | 宫崎贞夫;石桥修;中野力藏;目崎义宪 | 申请（专利权）人： | 富士通株式会社 |
| 主分类号： | G06F12/08 | 分类号： | G06F12/08 |
| 代理公司： | 隆天国际知识产权代理有限公司 | 代理人： | 姜 燕;陈 晨 |
| 地址： | 日本神奈*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明涉及一种数据处理装置，包括带有寄存器的CPU、高速缓冲存储器、构造为与该高速缓冲存储器交换数据的主存储器、构造为控制该主存储器和该高速缓冲存储器之间数据交换的控制部件、以及构造为为该寄存器、该高速缓冲存储器以及该主存储器供电的电源部件。所述寄存器、高速缓冲存储器以及主存储器中的每一个均构造为存储数据并在电源部件不供电的情况下保持其中所存储的数据。所述控制部件构造为在所述电源部件中发生异常的情况下，停止CPU访问寄存器、高速缓冲存储器以及主存储器。 | ||
| 搜索关键词： | 数据处理 装置 | ||
【主权项】：
1.一种数据处理装置，包括：CPU，包含寄存器；高速缓冲存储器；主存储器，构造为与所述高速缓冲存储器交换数据；控制部件，构造为控制所述主存储器与所述高速缓冲存储器之间的数据交换；以及电源部件，构造为为所述寄存器、所述高速缓冲存储器及所述主存储器供电；其中，所述寄存器、所述高速缓冲存储器及所述主存储器中的每一个均构造为存储数据，并在所述电源部件不供电的情况下保持存储在其中的数据；其中，所述控制部件构造为在所述电源部件中发生异常时停止所述CPU访问所述寄存器、所述高速缓冲存储器及所述主存储器。
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