[发明专利]处理器及高速缓冲存储器的控制方法无效
申请号: | 200910178614.8 | 申请日: | 2009-09-22 |
公开(公告)号: | CN102023699A | 公开(公告)日: | 2011-04-20 |
发明(设计)人: | 陈俊裕 | 申请(专利权)人: | 奇景光电股份有限公司 |
主分类号: | G06F1/32 | 分类号: | G06F1/32;G06F12/08 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 史新宏 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | 一种处理器及高速缓冲存储器的控制方法。处理器包括多个高速缓冲存储器(cache)与一控制单元。多个高速缓冲存储器分别受控于多个高速缓冲存储器致能信号而被启动。控制单元根据处理器的电源模式产生高速缓冲存储器致能信号,以选择并存取高速缓冲存储器的对应上述电源模式的子集,其中高速缓冲存储器的子集数量决定于电源模式。因此,处理器可根据电源模式要求高速缓冲存储器启动以减少高速缓冲存储器的功率消耗。 | ||
搜索关键词: | 处理器 高速 缓冲存储器 控制 方法 | ||
【主权项】:
一种处理器,包括:多个高速缓冲存储器,分别受控于多个高速缓冲存储器致能信号而被启动;以及一控制单元,根据该处理器的一电源模式产生这些高速缓冲存储器致能信号,以选择并存取这些高速缓冲存储器的对应该电源模式的子集,其中这些高速缓冲存储器的子集数量决定于该电源模式。
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