[发明专利]将逻辑图转换为时序图的方法和系统有效
| 申请号： | 200910189935.8 | 申请日： | 2009-09-01 |
| 公开（公告）号： | CN101846980A | 公开（公告）日： | 2010-09-29 |
| 发明（设计）人： | 吕爱国;江国进;黄伟军;孙永滨;刘光明 | 申请（专利权）人： | 中广核工程有限公司;中国广东核电集团有限公司 |
| 主分类号： | G05B19/02 | 分类号： | G05B19/02;G21D3/00 |
| 代理公司： | 深圳市顺天达专利商标代理有限公司 44217 | 代理人： | 易钊 |
| 地址： | 518023 广*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及一种将逻辑图转换为时序图的方法，该方法包括，判断逻辑图的输入信息是否为完整信号，如果所述输入信息为完整信号，对所述输入信息进行时序图设计生成电子组态设计文件；如果所述输入信息为不完整信号，返回到逻辑图中调整所述输入信息，再判断是否为完整信号，直到所述输入信息为完整信号时对所述输入信息进行时序图设计生成电子组态设计文件。本发明还涉及一种将逻辑图转换为时序图的系统，该系统包括判断单元、设计单元、组合单元和调整单元。本发明实现将逻辑图转换为时序图，最终生成满足数字化控制系统组态需求的电子组态设计文件，转换过程简单，转换结果可靠、准确。 | ||
| 搜索关键词： | 逻辑 转换 时序 方法 系统 | ||
【主权项】：
一种将逻辑图转换为时序图的方法，其特征在于，包括，S1：判断逻辑图的输入信息是否为完整信号，是则进入步骤S2，否则进入步骤S4；S2：对所述输入信息进行时序图设计生成数据包文件；S3：生成电子组态设计文件，跳至步骤S5；S4：返回到逻辑图中调整所述输入信息，再进入步骤S1；S5：结束。
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