[发明专利]实现对数运算的装置及方法无效
| 申请号： | 200910202008.5 | 申请日： | 2009-12-21 |
| 公开（公告）号： | CN102103480A | 公开（公告）日： | 2011-06-22 |
| 发明（设计）人： | 张帆;金方其 | 申请（专利权）人： | 卓胜微电子(上海)有限公司 |
| 主分类号： | G06F7/556 | 分类号： | G06F7/556 |
| 代理公司： | 上海浦一知识产权代理有限公司 31211 | 代理人： | 戴广志 |
| 地址： | 201203 上海市浦东新*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种实现对数运算的装置，输入控制逻辑模块，用于把输入X的值转换成A，B，S的值，并赋值给寄存器A，寄存器B，寄存器S，初始化所述寄存器；寄存器K，其输出端与迭代比较控制模块连接，用于存储设定的常数K；累加器CNT，在迭代比较控制模块的控制下进行累加计算；迭代比较控制模块，用于以迭代方式获得对数运算结果；MUX模块，根据累加值CNT的值和寄存器S中的符号指示位S，得到最终的对数结果Y。本发明还公开了一种实现对数运算的方法。本发明能够根据需要进行灵活配置实现不同精度不同底数的对数运算，并且结构简单，实现的低复杂度。 | ||
| 搜索关键词： | 实现 对数 运算 装置 方法 | ||
【主权项】：
一种实现对数运算的装置，其特征在于，包括：输入控制逻辑模块，用于把输入X的值转换成A，B，S的值，并赋值给寄存器A，寄存器B，寄存器S，初始化所述寄存器；寄存器A，寄存器B，寄存器S，其输入端与输入控制逻辑模块连接，分别用于存储A，B，S的值；寄存器K，其输出端与迭代比较控制模块连接，用于存储设定的常数K，且K为大于1的有理数；一累加器CNT，其输入端与迭代比较控制模块连接，输出端与MUX模块连接，在所述迭代比较控制模块的控制下进行累加计算；迭代比较控制模块，与所述寄存器A，寄存器B，寄存器K，累加器CNT连接，用于以迭代方式获得对数运算结果；MUX模块，根据累加值CNT的值和寄存器S中的符号指示位S，得到最终的对数结果Y。
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