[发明专利]一种可配置复用数字内插和数字滤波功能的数字示波器有效
申请号: | 200910243906.5 | 申请日: | 2009-12-25 |
公开(公告)号: | CN102109542A | 公开(公告)日: | 2011-06-29 |
发明(设计)人: | 王悦;王铁军;李维森 | 申请(专利权)人: | 北京普源精电科技有限公司 |
主分类号: | G01R13/02 | 分类号: | G01R13/02 |
代理公司: | 北京北新智诚知识产权代理有限公司 11100 | 代理人: | 陈曦 |
地址: | 102206 北*** | 国省代码: | 北京;11 |
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摘要: | 本发明公开了一种可配置复用数字内插和数字滤波功能的数字示波器。该数字示波器中包括由FPGA实现的数字内插滤波模块,数字内插滤波模块根据内插/滤波选通信号确定当前操作模式,接收输入数据并存储,经过延迟处理之后的数据及滤波系数送入乘累加计算单元进行计算,计算结果送入后续运算单元中;后续计算单元根据当前操作模式决定是否需要进行累加计算,当操作模式为数字内插运算时直接将计算结果作为插值结果输出,当操作模式为数字滤波运算时先进行累加计算再输出数字滤波运算结果。本数字示波器将数字内插与数字滤波两种信号处理方式合二为一,通过配置复用的模式加以实现,有效节省了FPGA的内部资源,是一种十分经济高效的做法。 | ||
搜索关键词: | 一种 配置 数字 内插 滤波 功能 示波器 | ||
【主权项】:
一种可配置复用数字内插和数字滤波功能的数字示波器,包括控制处理模块,其特征在于:所述数字示波器中还包括由FPGA实现的数字内插滤波模块,所述数字内插滤波模块包括顺序连接的数据存储单元、数据延迟链单元和数据计算单元,所述数据计算单元中包括乘累加计算单元和后续计算单元;所述控制处理模块输出内插/滤波选通信号,所述数字内插滤波模块根据所述内插/滤波选通信号确定当前操作模式,接收输入数据并存储,将已存储的输入数据及滤波系数送入所述数据延迟链单元进行延迟处理,经过延迟处理之后的数据及滤波系数送入所述乘累加计算单元进行计算,计算结果继续送入所述后续运算单元中;所述后续计算单元根据当前操作模式决定是否需要进行累加计算,当操作模式为数字内插运算时直接将所述计算结果作为插值结果输出,当操作模式为数字滤波运算时先进行累加计算再输出数字滤波运算结果。
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