[实用新型]一种传输数据链路冗余切换的装置无效
申请号: | 200920027239.2 | 申请日: | 2009-06-10 |
公开(公告)号: | CN201444642U | 公开(公告)日: | 2010-04-28 |
发明(设计)人: | 刘强;金长新;田凯 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
主分类号: | H04L29/08 | 分类号: | H04L29/08;H04L1/22 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 250014 *** | 国省代码: | 山东;37 |
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摘要: | 本实用新型公开了一种传输数据链路冗余切换的装置,属于一种传输数据的装置,其结构包括PC、磁盘阵列和IOP平台,IOP平台为冗余设置,每个IOP平台均包括IOP主板、DDR内存、千兆网、SATA控制器、XRS10L140、FLASH、CPLD和NVSRAM;PC分别通过两个IOP平台的千兆网与两个IOP平台的IOP主板连接,两个IOP平台的IOP主板分别通过各自的SATA控制器再由数据线与磁盘阵列连接。本实用新型的一种传输数据链路冗余切换的装置和现有技术相比,具方法简单,可靠,可以实现在一条数据传输链路出现问题时,另一条链路顺利的接替它继续传输,保证了数据传输的稳定性。 | ||
搜索关键词: | 一种 传输 数据链 冗余 切换 装置 | ||
【主权项】:
一种传输数据链路冗余切换的装置,包括PC、磁盘阵列和IOP平台,PC与IOP平台连接,IOP平台通过数据线与磁盘阵列连接;其特征在于IOP平台为冗余设置,每个IOP平台均包括IOP主板、DDR内存、千兆网、SATA控制器、XRS10L140、FLASH、CPLD和NVSRAM;每个IOP平台的DDR内存、千兆网、SATA控制器、FLASH、CPLD和NVSRAM均与IOP主板连接,其中千兆网和SATA控制器通过PCI总线与IOP主板连接,FLASH、CPLD和NVSRAM通过PBI总线与IOP主板连接,SATA控制器连接XRS10L140,CPLD通过数据总线控制FLASH和NVRAM;PC分别通过两个IOP平台的千兆网与两个IOP平台的IOP主板连接,两个IOP平台的IOP主板分别通过各自的SATA控制器再由数据线与磁盘阵列连接。
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