[发明专利]用于降低电路复杂度的非二进制解码器架构以及控制信号逻辑有效
| 申请号： | 200980152545.1 | 申请日： | 2009-11-04 |
| 公开（公告）号： | CN102265349A | 公开（公告）日： | 2011-11-30 |
| 发明（设计）人： | 马蒂亚斯·N·特罗科利 | 申请（专利权）人： | 奈克斯特生物测定学公司 |
| 主分类号： | G11C8/00 | 分类号： | G11C8/00 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 臧建明;孟金喆 |
| 地址： | 挪威*** | 国省代码： | 挪威;NO |
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| 摘要： | 公开了一种解码器，其用于响应时钟信号输入顺序使能输出，其包括对应于X个解码器输出的X个逻辑级。每个逻辑级都具有多个输入，其中每个逻辑级都包括少于log2X个用于接收时钟信号输入的输入。 | ||
| 搜索关键词： | 用于 降低 电路 复杂度 二进制 解码器 架构 以及 控制 信号 逻辑 | ||
【主权项】：
一种用于响应时钟信号输入顺序使能输出的解码器，包括：X个逻辑级，其对应于X个解码器输出，每个逻辑级都具有多个输入，其中每个逻辑级包括少于log2X个用于接收时钟信号输入的输入。
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