[发明专利]数据写入系统与数据写入方法有效
申请号: | 201010003937.6 | 申请日: | 2010-01-13 |
公开(公告)号: | CN102129353B | 公开(公告)日: | 2017-04-12 |
发明(设计)人: | 蔡来福;陈庆聪 | 申请(专利权)人: | 群联电子股份有限公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06;G06F12/02 |
代理公司: | 北京同立钧成知识产权代理有限公司11205 | 代理人: | 刘芳 |
地址: | 中国台湾*** | 国省代码: | 台湾;71 |
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摘要: | 本发明提供了一种闪存储存系统、闪存控制器与数据写入方法,该闪存储存系统包括闪存芯片与闪存控制器。闪存控制器配置闪存芯片的一第二实体单元作为对应一第一实体单元的中途快取实体单元,并且将对应第一主机写入指令的第一数据与对应主机写入指令的第二数据暂存于此中途快取实体单元的快速实体地址中,其中此第一数据与第二数据对应此第一实体单元的慢速实体地址。之后,闪存控制器将第一数据与第二数据从此中途快取实体单元中同步地复制至第一实体单元中,由此缩短写入数据至闪存芯片所需的时间。 | ||
搜索关键词: | 闪存 储存 系统 控制器 数据 写入 方法 | ||
【主权项】:
一种数据写入系统,用于一闪存芯片,其中该闪存芯片具有多个实体区块,每一所述实体区块具有多个实体地址,所述实体地址包括多个快速实体地址与多个慢速实体地址,并且写入数据至所述快速实体地址的速度快于写入数据至所述慢速实体地址的速度,该数据写入系统包括:第一模块,用于从一主机系统中接收一笔第一数据;第二模块,用于判断该笔第一数据是否欲被写入至该闪存芯片的慢速实体地址;第三模块,用于当该笔第一数据欲被写入至该闪存芯片的慢速实体地址时,将该笔第一数据暂存至该闪存芯片的快速实体地址之中的一第一快速实体地址中;第四模块,用于当该笔第一数据非欲被写入至该闪存芯片的慢速实体地址时,将该笔第一数据写入至该闪存芯片的快速实体地址之中的一对应快速实体地址中;以及第五模块,用于当暂存至所述快速实体地址中的多笔数据的数量达到一预定值时,将暂存至所述快速实体地址中的所述多笔数据中的至少两笔数据以一同步方式写入至该闪存芯片的慢速实体地址之中的至少两个对应慢速实体地址中,其中该预定值不小于2笔。
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