[发明专利]缓存控制装置、缓存控制方法及程序有效
| 申请号： | 201010107493.0 | 申请日： | 2010-02-09 |
| 公开（公告）号： | CN101808242A | 公开（公告）日： | 2010-08-18 |
| 发明（设计）人： | 长尾真一;细井隆宏;志田修利 | 申请（专利权）人： | 索尼公司 |
| 主分类号： | H04N7/26 | 分类号： | H04N7/26;H04N7/50 |
| 代理公司： | 北京信慧永光知识产权代理有限责任公司 11290 | 代理人： | 褚海英;武玉琴 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种缓存控制装置，其包括：基准时间生成单元，其用于基于包含在输入数据流内的时间信息生成基准时间；缓存器，其用于接收从数据流提取的编码数据，存储编码数据，并在编码数据的解码时间或再现时间输出编码数据；以及控制单元，其用于基于编码数据的解码时间或再现时间与基准时间之间的相对关系，控制编码数据向缓存器的输入。本发明无需为了切换音频输出而使用另外的缓存器以存储音频信号，就能够将无声时段限制在预定时间段内。 | ||
| 搜索关键词： | 缓存 控制 装置 方法 程序 | ||
【主权项】：
一种缓存控制装置，其包括：基准时间生成单元，其用于基于包含在输入数据流内的时间信息生成基准时间；缓存器，其用于接收从所述数据流中提取出的编码数据，存储所述编码数据，并在所述编码数据的解码时间或再现时间输出所述编码数据；以及控制单元，其用于基于所述编码数据的所述解码时间或所述再现时间与所述基准时间之间的相对关系，控制所述编码数据向所述缓存器的输入。
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