[发明专利]非循序执行的微处理器及其操作方法无效
| 申请号： | 201010185576.1 | 申请日： | 2010-05-19 |
| 公开（公告）号： | CN101847094A | 公开（公告）日： | 2010-09-29 |
| 发明（设计）人： | 马修·D·戴;罗德尼·E·虎克 | 申请（专利权）人： | 威盛电子股份有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 钱大勇 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明提供一种非循序执行微处理器，用以减少因储存碰撞而重新执行加载指令的可能性，包括：队列存储器以及暂存器别名表。队列存储器包括多个项目，每个项目用以存放加载指令的指令指针和用来识别储存指令的信息，信息会使得第一加载指令在执行时被要求重新执行。暂存器别名表耦接于队列存储器，用于依据循序排列的多个指令以产生多个相依性，以便判断多个指令何时能够非循序执行，其中暂存器别名表用以在遇到第二加载指令时，判断第二加载指令的指令指针是否符合于队列存储器的项目的一者的指令指针，以及当判断符合时，使得第二加载指令依附于所符合的项目中的信息所识别的储存指令。 | ||
| 搜索关键词： | 循序 执行 微处理器 及其 操作方法 | ||
【主权项】：
一种非循序执行微处理器，用以减少因储存碰撞而重新执行加载指令的可能性，包括：一队列存储器，包括多个项目，每个上述项目用以存放加载指令的一指令指针和用来识别一储存指令的信息，上述信息会使得一第一加载指令在执行时被要求重新执行；以及一暂存器别名表，耦接于上述队列存储器，用于依据循序排列的多个指令以产生多个相依性，以便判断上述多个指令何时能够非循序执行，其中上述暂存器别名表用以在遇到一第二加载指令时，判断上述第二加载指令的指令指针是否符合于上述队列存储器的项目的一者的指令指针，以及当判断符合时，使得上述第二加载指令依附于所符合的项目中的信息所识别的上述储存指令。
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