[发明专利]乘加方法及乘加器有效
| 申请号： | 201010559289.2 | 申请日： | 2010-11-25 |
| 公开（公告）号： | CN101986260A | 公开（公告）日： | 2011-03-16 |
| 发明（设计）人： | 彭元喜;谢刚;杨惠;陈书明;刘衡竹;郭阳;孙永节;刘宗林;龚国辉;鲁建壮;许邦建 | 申请（专利权）人： | 中国人民解放军国防科学技术大学 |
| 主分类号： | G06F7/57 | 分类号： | G06F7/57 |
| 代理公司： | 湖南兆弘专利事务所 43008 | 代理人： | 周长清 |
| 地址： | 410073 湖南省长沙市开福区砚瓦池正街47号*** | 国省代码： | 湖南;43 |
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| 摘要： | 一种乘加方法及乘加器，该方法的步骤为：（1）乘数通过布什编码逻辑单元产生若干控制信号，被乘数作为部分积产生逻辑单元的输入，产生部分积；（2）加数通过加数分块逻辑单元得到低位截取部分、中间部分和高位截取部分；前两者以及部分积作为改进华莱士树单元的输入，得到的结果作为加法器的输入，产生低位结果和控制信号；（3）高位截取部分经高位预测逻辑单元得到高位结果；（4）低位结果与高位结果经拼接逻辑单元后产生一个最终结果。该乘加器包括布什编码逻辑单元、部分积产生逻辑单元、加数分块逻辑单元、加法器、高位预测逻辑单元、改进华莱士树单元以及拼接逻辑单元。本发明具有结构简单紧凑、成本低廉、运算速度快、稳定可靠等优点。 | ||
| 搜索关键词： | 方法 乘加器 | ||
【主权项】：
一种乘加方法，其特征在于步骤为：（1） 乘数通过布什编码逻辑单元产生若干控制信号，被乘数作为部分积产生逻辑单元的输入，根据控制信号产生部分积；（2） 加数通过加数分块逻辑单元得到三个输出，分别是低位截取部分、中间部分和高位截取部分；所述低位截取部分、中间部分以及部分积作为改进华莱士树单元的输入，得到一个“和”和一个“进位”，其中“和”与“进位”的位数相同，“进位”的权值比“和”的权值高1；“和”与“进位”作为加法器的输入，产生一个低位结果和一个控制信号；（3） 高位截取部分作为高位预测逻辑单元的一个输入，在控制信号的控制下，产生一个高位结果；（4） 低位结果与高位结果作为拼接逻辑单元的输入，产生一个最终结果。
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