[实用新型]用于并行存储器向多个串行接口并行传送数据的传输系统无效
| 申请号： | 201020687335.2 | 申请日： | 2010-12-29 |
| 公开（公告）号： | CN202067262U | 公开（公告）日： | 2011-12-07 |
| 发明（设计）人： | 朱石雄 | 申请（专利权）人： | 朱石雄 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 李赞坚;曹志霞 |
| 地址： | 511430 广东省广州市番禺*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型公开一种用于并行存储器向多个串行接口并行传送数据的传输系统，包括一存储器、一MCU及多个串入并出芯片；还包括一数据结构调整模块，用于将需传送数据调整为预定格式之后存入所述存储器；并且，所述存储器通过并行数据线与所述MCU连接；和，所述多个串入并出芯片并行排列，其中每个串入并出芯片分别连接到所述MCU之一个I/O端口的一个数据位上。本实用新型的MCU同时控制多个并行排列的串入并出芯片，其因为去掉了并串转换时间，同时也不要逐个bit移位，所以总的传送时间大大减少，从而提高了数据传送效率。 | ||
| 搜索关键词： | 用于 并行 存储器 串行 接口 传送 数据 传输 系统 | ||
【主权项】：
一种用于并行存储器向多个串行接口并行传送数据的传输系统，包括一存储器、一MCU及多个串入并出芯片，其特征在于，包括一数据结构调整模块，用于将需传送数据调整为预定格式之后存入所述存储器；并且，所述存储器通过并行数据线与所述MCU连接；和，所述多个串入并出芯片并行排列，其中每个串入并出芯片分别连接到所述MCU之一个I/O端口的一个数据位上。
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