[发明专利]用于校验锁相环中的输出频率的系统和方法有效

专利信息
申请号: 201080002068.3 申请日: 2010-05-13
公开(公告)号: CN102859879A 公开(公告)日: 2013-01-02
发明(设计)人: 安德鲁·甲库伯;克里斯蒂·古;安德鲁·埃莫瑞科;欧拉·皮特森;李冰新 申请(专利权)人: 华为技术有限公司
主分类号: H03L7/06 分类号: H03L7/06;H03L7/085
代理公司: 暂无信息 代理人: 暂无信息
地址: 518129 广东*** 国省代码: 广东;44
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摘要: 一种用于锁相环PLL的数字校验系统DCS,其中,PLL包括:用于响应参考信号和反馈信号并发送调节电压的PLL控制器、和用于响应调节电压并将反馈信号作为输出信号发送的压控振荡器VCO;所述调节电压用于确定是否需要增加或降低输出信号的频率,DCS包括:调压控制器TVC,用于设置调节电压;相位差计量器PDQ,用于在将参考信号的相位与反馈信号的相位进行比较后,输出相位差;以及数字控制器DC,用于接收PDQ输出的相位差,并输出粗调信号以调节反馈信号,使得PDQ的平均相位差为0。本发明实施例提供的校验方法、系统,在使用中具有较高的精度并能够快速校验。
搜索关键词: 用于 校验 环中 输出 频率 系统 方法
【主权项】:
一种用于锁相环PLL的数字校验系统DCS,其中,PLL包括:用于响应参考信号和反馈信号并发送调节电压的PLL控制器、和用于响应调节电压并将反馈信号作为输出信号发送的压控振荡器VCO;所述调节电压用于确定是否需要增加或降低输出信号的频率,其特征在于:DCS包括:调压控制器TVC,用于设置调节电压;相位差计量器PDQ,用于在将参考信号的相位与反馈信号的相位进行比较后,输出相位差;以及数字控制器DC,用于接收PDQ输出的相位差,并输出粗调信号以调节反馈信号,使得PDQ的平均相位差为0。
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