[发明专利]隔离型功率晶体管的制造方法有效
申请号: | 201110242328.0 | 申请日: | 2011-08-23 |
公开(公告)号: | CN102956487A | 公开(公告)日: | 2013-03-06 |
发明(设计)人: | 韩峰;段文婷 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/331 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201206 上*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种隔离型功率晶体管的制造方法,本发明方法通过在栅多晶硅顶部形成的绝缘介质层、以及绝缘介质层侧面形成的侧壁介质层作为刻蚀形成器件之间的隔离层沟槽的硬掩膜,不需要增加额外的掩膜版就能在晶体管之间形成绝缘隔离层,既不会降低芯片内晶体管的密度,又能减少器件之间的串扰影响,有利于提高减少晶体管尺寸和提高芯片内晶体管的密度,能获得具有更小的导通电阻、更低的饱和压降和更大的电流驱动能力的功率器件。本发明方法因为不需要增加额外的掩膜版,所以还能降低制造成本。 | ||
搜索关键词: | 隔离 功率 晶体管 制造 方法 | ||
【主权项】:
一种隔离型功率晶体管的制造方法,其特征在于,隔离型功率晶体管的栅极为沟槽型结构,包括如下步骤:步骤一、在顶部形成有P型阱的N型承压区上形成沟槽,该沟槽穿过所述P型阱并进入到所述N型承压区中,在所述沟槽的底部和侧壁表面形成栅氧化层;步骤二、在所述沟槽中填入N型栅多晶硅,所述栅多晶硅的顶部进入所述P型阱中但未将所述沟槽填满,所述栅极由所述栅多晶硅形成;在所述沟槽中再填入绝缘介质层,所述绝缘介质层位于所述栅多晶硅的顶部并将所述沟槽完全填满;步骤三、以所述绝缘介质层为第一掩膜进行第一次刻蚀,所述第一次刻蚀是对所述沟槽外的所述P型阱进行刻蚀,所述P型阱被刻蚀掉部分厚度;步骤四、在所述绝缘介质层的侧面形成侧墙介质层;以所述绝缘介质层和所述侧墙介质层为第二掩膜进行第二次刻蚀并形成第二沟槽,所述第二次刻蚀的刻蚀深度大于所述P型阱的深度、所述第二沟槽穿过所述P型阱并进入到所述N型承压区中;步骤五、淀积第二绝缘介质层将所述第二沟槽填满;步骤六、去除所述侧墙介质层;进行源极注入形成源极,进行背栅接触注入形成背栅接触区;形成金属接触。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造