[发明专利]具有超厚顶层金属的集成电路的制作方法及集成电路无效
申请号: | 201110388318.8 | 申请日: | 2011-11-29 |
公开(公告)号: | CN102437107A | 公开(公告)日: | 2012-05-02 |
发明(设计)人: | 李磊;胡友存;姬峰;张亮;陈玉文 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L23/522 |
代理公司: | 隆天国际知识产权代理有限公司 72003 | 代理人: | 阚梓瑄;冯志云 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | 本发明提出一种具有超厚顶层金属的集成电路的制作方法及具有超厚顶层金属的集成电路,制作方法包括:在半导体基板的金属层上沉积刻蚀阻挡层、介电层;旋涂第一光刻胶层,通过通孔光掩模版光刻形成通孔图形和冗余沟槽图形;刻蚀部分介电层形成部分通孔和冗余沟槽;旋涂第二光刻胶层,通过金属层光掩模版光刻形成金属沟槽图形;刻蚀介电层形成金属沟槽;刻蚀打开通孔底部刻蚀阻挡层;沉积金属阻挡层和铜籽晶层,填充金属铜,化学机械研磨平坦化金属表面,形成超厚顶层金属层双大马士结构。本发明集成电路由本发明的方法制成。本发明能兼容部分通孔优先双大马士革工艺,制作工艺简单,在改善超厚顶层金属诱导的基板扭曲变形的同时不会恶化研磨工艺。 | ||
搜索关键词: | 具有 顶层 金属 集成电路 制作方法 | ||
【主权项】:
具有超厚顶层金属的集成电路的制作方法,其特征在于,包括如下步骤:S1、在半导体基板(1)的金属层上依次沉积刻蚀阻挡层(2)和介电层(3);S2、在所述介电层(3)上旋涂第一光刻胶层(4),通过通孔光掩模版光刻形成通孔图形(41)和冗余沟槽图形(42),其中所述通孔图形(41)位于所述半导体基板(1)的金属层内的铜互连线(11)上方;S3、沿着所述通孔图形(41)和冗余沟槽图形(42)向下部分刻蚀所述介电层(3),形成部分通孔(31)和冗余沟槽(32),其中刻蚀深度要求为:保证后续金属沟槽刻蚀后所述部分通孔(31)底部正好置于所述刻蚀阻挡层(2)上表面;然后,去除所述第一光刻胶层(4)的剩余部分;S4、在所述介电层(3)上旋涂第二光刻胶层(5),通过金属层光掩模版光刻形成金属沟槽图形(51);S5、沿着所述金属沟槽图形(51)向下刻蚀所述介电层(3),使所述部分通孔(31)底部止于所述刻蚀阻挡层(2)上表面;去除所述第二光刻胶层(5)的剩余部分;继续刻蚀打开所述部分通孔(31)底部的刻蚀阻挡层(2),露出所述铜互连线(11),形成金属沟槽(6)和通孔(61);S6、金属化超厚顶层金属层:分别在所述通孔(61)、所述金属沟槽(6)和所述冗余沟槽(32)内壁上沉积金属阻挡层和铜籽晶层;然后分别在所述通孔(61)、所述金属沟槽(6)和所述冗余沟槽(32)内电镀填充金属铜;化学机械研磨所述金属铜,表面平坦化,去除所述介电层(3)上多余金属,最终形成具有超厚互连线金属(7)、互连通孔(71)和浅冗余金属(8)的超厚顶层金属层双大马士结构。
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H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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